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제품 상세 정보:
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채널 수 :: | 1 전송, 1 수신 | 주파수 범위 :: | 0-6000HZ |
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대역폭 :: | 최고 20MHZ | 특징 :: | 온보드 FPGA 처리 |
FPGA :: | 자일링스 스파르타 사람 3A-DSP 3400 FPGA | ADC :: | 14는 100 MS / S를 억제합니다 |
하이 라이트: | USRP 에스디알 MIMO 1.3A,우스르프 보편적 소프트웨어 라디오 주변적 MIMO,1.3A 우스르프 보편적 소프트웨어 라디오 |
제품 개관
USRP-LW N210은 고다이나믹 범위, 고대역과 처리 능력을 제공합니다. 구조는 호스트 프로세서에 자일링스 스파르타 사람 3A DSP 3400 FPGA, 100 MS / S 듀얼 ADC, 400 MS / S 듀얼 DAC과 기가비트 이더넷 연결성을 스트림 데이터에 포함시킵니다.
주요 특징 :
1. 최대 전송 속도 :50MS/s
2. 기가비트 이더넷 연결
3. 단지 한 단일 송수신기에 접속-기초인 MIMO 케이블이 USRP-LW N210마다 연결되어서 MIMO 구조는 2 또는 더 많은 USRP-LW N210s에 의해 건설되어야 합니다
4. 온보드 FPGA 처리
5.FPGA :자일링스 스파르타 사람 XC3SD3400A
6. 아d스 : 14는 100 MS / S를 억제합니다
7. DACs : 16개 비트 - 400 MS / S
8. 외부 5 또는 10 마하즈 기준 클럭을 잠근 능력
9. 선택적 내부 GPS 서보 클록 - USRP-LW N210 GPSDO
계통도
상세한 성능 :
모듈 설계가 USRP-LW N210이 DC에서부터 6 기가헤르츠까지 작동할 수 있게 허락하는 반면에, 확장 포트는 다수 USRP-LW N210 직렬 장치가 MIMO 구성에서 동기화되고 사용될 수 있게 허락합니다. 선택적 GPSDO 모듈은 또한 세계적 GPS 표준의 0.01 ppm 이내에게 USRP-LW N210 기준 클럭을 훈련하는데 사용될 수 있습니다. USRP-LW N210은 호스트 애플리케이션에 최고 50까지 MS / S를 유출시킬 수 있습니다. 사용자들은 FPGA 구성에서, 또는 탑재하고 있는 32 비트 RISC 소프트코어에서 커스텀기능을 구현할 수 있습니다. USRP-LW N210은 추가적 논리, 메모리와 DSP 자원을 요구하는 응용을 위해 USRP-LW N200 보다 더 큰 FPGA를 제공합니다. FPGA는 또한 둘다 전송에서 최고 100까지 MS / S를 처리할 수 있는 가능성을 제공하고 방향을 받습니다. FPGA 펌웨어는 기가비트 이서넷 인터페이스를 통하여 재로딩될 수 있습니다.
기술적인 매개 변수 :
매개 변수 범주 | 수치 값 | 유닛 | 매개 변수 범주 | 수치 값 | 유닛 |
입출력 | WBX-LW와 쌍을 이룰 때 RF 성능은 매개변수화합니다 | ||||
직류전압 입력 | 6 | V | 단일 사이드밴드 신호 / 이미지 제거 | 35/50 | dBc |
경향 | 1.3 | A | 위상 노이즈 (1.8GHz). | ||
경향은 WBX 딸을 설치할 때 타세요 | 2.3 | A | 10kHz | -80 | dBc/Hz |
컨버트 모듈 매개 변수 | 100 킬로 헤르츠 | -100 | dBc/Hz | ||
ADC 샘플링률 | 100 | MS / S | 1MHz | -137 | dBc/Hz |
ADC 결의안 | 14 | 비트 | 출력 전원 | 15 | 데이터 베이스 관리 프로그램 |
ADC SFDR | 88 | dBc | 제3차 차단점에 들어가세요 | 0 | 데이터 베이스 관리 프로그램 |
DAC 샘플링률 | 400 | MS / S | 소음 지수 | 5 | dB |
DAC 결의안 | 16 | 비트 | 물성 | ||
DAC SFDR | 80 | dBc | 작동 온도 | 0-55 | C |
호스트 최대 율 (8b/16b)로. | 50/25 | MS / S | 사이즈 | 225×165×50 | 밀리미터 |
국부진동 정확도 | 2.5 | ppm | 중량 | 1.0 | 킬로그램 |
잠금장치 GPSDO 정확성 | 0.01 | ppm |
이 장비에서 포함되어 있습니다 :
1. USRP-LW N210
2. 2 SMA 칸막이 케이블
3. 1 기가비트 Ethernet 케이블
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